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[单选题]

已知流密码的输出序列的一个周期为1100101,该序列的1-游程有个()。

A.4

B.1

C.3

D.2

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第1题
设一个3级线性反馈移位寄存器(LFSR)的特征多项式为[图...

设一个3级线性反馈移位寄存器(LFSR)的特征多项式为。 (1) 画出该LFSR的框图; (2) 给出输出序列的递推关系式; (3) 设初始状态(a0,a1,a2)=(0,0,1),写出输出序列及序列周期。 (4) 列出序列的游程。

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第2题
对于稳定的因果系统,如果输入一个频率为ω0的复正弦序列,则其输出为y(n)=______,设系统的频率响应H(ejω)已知

对于稳定的因果系统,如果输入一个频率为ω0的复正弦序列,则其输出为y(n)=______,设系统的频率响应H(e)已知。

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第3题
若用一个由9级线性反馈移存器产生的,m序列进行测距,已知最远目标为1500km,试求加于移存器的定时脉冲的最短

周期应为多少?

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第4题
若()的输入为准周期序列,则其输出也是一个准周期序列。

若()的输入为准周期序列,则其输出也是一个准周期序列。

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第5题
已知n=11时,本原多项式的个数λ(11)=176,又已知211-1=2047,则下列关于LFSR的叙述中正确的是()。

A.11级LFSR可以生成211-1=2047个m序列

B.11级LFSR可以输出的m序列共有176个,它们的周期与LFSR的初态有关,共有176种可能的取值

C.11级LFSR可以输出的m序列共有176个,它们一共可以生成176×2047=360272个不同的密钥流

D.11级LFSR可以输出的m序列176个,它们一共可以生成2047个不同的密钥流

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第6题
已知某m序列的周期是15,一个周期中的前4个比特是1111,请写出完整的一个周期。

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第7题
已知两个定长数组,它们分别存放两个非降序有序序列,请编写程序把第二个数组序列中的数逐个插入到
前一个数组序列中,完成后两个数组中的数分别有序(非降序)并且第一数组中所有的数都不大于第二个数组中的任意一个数。注意:不能另开辟数组,也不能对任意一个数组进行排序操作。例如: 第一个数组为:4,12,28 第二个数组为:1,7,9,29,45 输出结果为:1,4,7(第一个数组) 9,12,28,29,45(第二个数组)

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第8题
已知单总线计算机结构如图9.7所示,其中XR为变址寄存器,EAR为有效地址寄存器,LATCH为暂存器。假设
指令地址已存于PC中,画出ADD * D指令周期信息流程图,并列出相应的控制信号序列。 说明: (1)ADD * D指令字中*表示相对寻址,D为相对位移量。 (2)寄存器的输入和输出均受控制信号控制,如PCi表示PC的输入控制信号,又如MDRo表示MDR的输出控制信号。 (3)凡是需要经过总线实现寄存器之间的传送,需在流程图中注明,如PC→Bus→MAR,相应的控制信号为PCo和MARi。

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第9题
已知两个定长数组A、B,它们分别存放两个非降序有序序列,请编写程序把数组B序列中的数逐个插入到数
组A序列中,完成后两个数组中的数分别有序(非降序)并且数组A中所有的数都不大于数组B中的任意一个数。要求,不能另开辟空间,也不能对任意一个数组进行排序操作。例如, 数组A为:4,12,28; 数组B为:1,7,9,29,45 输出结果为:1,4,7(数组A) 9,12,28,29,45(数组B)

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第10题
已知单总线计算机结构如图9.7所示,其中M为主存,XR为变址寄存器,EAR为有效地址寄存器,LATCH为暂存
器。假设指令地址已存于PC中,画出ADD X,D指令周期信息流程图,并列出相应的控制信号序列。

说明: (1)ADD X,D指令字中x为变址寄存器XR,D为形式地址。 (2)寄存器的输入和输出均受控制信号控制,如PCi表示PC的输入控制信号,又如MDRo表示MDR的输出控制信号。 (3)凡是需要经过总线实现寄存器之间的传送,需在流程图中注明,如PC→Bus→MAR,相应的控制信号为PCo和MARi。

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第11题
若已知一个栈的入栈序列是1,2,3,…,n,其输出序列为p1,p2,p3,…,pn,若pn是n,则pi是()。A.iB.n

若已知一个栈的入栈序列是1,2,3,…,n,其输出序列为p1,p2,p3,…,pn,若pn是n,则pi是()。

A.i

B.n-i

C.n-i+l

D.不确定

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