已知某集成计数器的结构图及逻辑符号如图所示,虚线以内为集成电路的内部电路。要求: (1)单片计数器能实现
已知某集成计数器的结构图及逻辑符号如图所示,虚线以内为集成电路的内部电路。要求:
(1)单片计数器能实现的最大模值为多少;
(2)画出用该计数器实现五进制计数器的逻辑图;
(3)画出用该计数器实现六进制计数器的逻辑图;
(4)画出用该计数器实现三十进制计数器的逻辑图。
已知某集成计数器的结构图及逻辑符号如图所示,虚线以内为集成电路的内部电路。要求:
(1)单片计数器能实现的最大模值为多少;
(2)画出用该计数器实现五进制计数器的逻辑图;
(3)画出用该计数器实现六进制计数器的逻辑图;
(4)画出用该计数器实现三十进制计数器的逻辑图。
已知某十进制集成计数器的逻辑符号及功能表如图4-57(a)、(b)所示,试画出在图4-57(c)所示输入信号作用下Q0、Q1、Q2、Q3及
的输出波形。
已知集成移位寄存器的逻辑符号功能表如图4-66(a)、(b)所示,试画出在图4-66(c)所示信号作用下Q7、
的输出波形。
集成计数器CT74290的内部结构及逻辑符号如图所示,它是二一五一十进制计数器。请完成下列问题。
(1)单片CT74290的最大计数模值为多少?它是同步还是异步计数器?
(2)欲构成二十四进制计数器,需要几片CT74290?
(3)R0(1)R0(2)和S9(1)S9(2)的作用是什么?
(4)画出用CT74290构成二十四进制计数器的连接图。
某系统ASM图如图5-32所示,试设计该图描述的控制器(条件输出块和状态块所标符号为输出信号)。 (1)以触发器为核心; (2)以集成计数器为核心; (3)以集成多D触发器为核心,并采用“一对一”的设计方法。
某随动系统,忽略小时间常数,采用并联校正,其简化的结构图如图5所示,其中,已知Tm=0.5s,Kobj为电压放大、功率放大及调节对象放大系数的乘积,数值较大。现要求:超调量σ≤5%,过渡过程时间ts=300ms。试用并联校正对系统进行动态设计。
1)求出Wc(s)传递函数的形式与参数。
2)求出满足该指标的Kobj值。
3)画出用并联校正时的系统对数幅频特性。
TTL集成施密特触发器CTll32的逻辑符号和vI一vO曲线如图9.6.1(a)所示,图(b)为CTll32组成的电路。 (1)说明电路具有什么功能。 (2)定性画出VA,VO的波形。 (3)若R=10 kΩ,C=0.01μF,计算工作周期。
已知一位二进制全加器逻辑符号如图10.52(a)所示,进位输出表达式Co=G+P·Ci(其
中G=Ai·Bi,P=Ai+Bi),试求采用超前进位结构的三位二进制加法器(如图10.52(b)所示)的最高位进位输出表达式Co3.