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[主观题]

图21－63为一时序逻辑电路，试列出Q2，Q1，Q0的状态真值表，并根据图示CP脉冲波形画出Q2，Q1，Q0的波形图（设各触发

图21-63为一时序逻辑电路，试列出Q₂，Q₁，Q₀的状态真值表，并根据图示CP脉冲波形画出Q₂，Q₁，Q₀的波形图(设各触发器Q端初始为0)。

图21－63为一时序逻辑电路，试列出Q2，Q1，Q0的状态真值表，并根据图示CP脉冲波形画出Q2，Q

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第1题

已知一Moore型时序逻辑电路的状态图如图P6-5所示，试列出该时序逻辑电路的状态表。设初始状态为0

00,触发器为上升沿起作用，画出其工作波形图(不少于8个时钟脉冲)。

已知一Moore型时序逻辑电路的状态图如图P6-5所示，试列出该时序逻辑电路的状态表。设初始状态为0

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第2题

分析图5．3．5所示同步时序逻辑电路，试列出电路的状态表，画出状态图和在CP时钟脉冲信号作用下L的波

形图，并确定电路逻辑功能。(设各触发器初态均为0)

分析图5．3．5所示同步时序逻辑电路，试列出电路的状态表，画出状态图和在CP时钟脉冲信号作用下L的波

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第3题

试画出图6．2．17所示电路的输出（Q2、Q1和Z)时序图，设初态Q2=Q1=0。

试画出图6．2．17所示电路的输出(Q2、Q1和Z)时序图，设初态Q2=Q1=0。

试画出图6．2．17所示电路的输出（Q2、Q1和Z)时序图，设初态Q2=Q1=0。试画出图6．2．1

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第4题

图3.16所示逻辑电路所用器件为74LS153(双4选1多路开关),试列出F₁,F₂的逻辑函数表达式

图3.16所示逻辑电路所用器件为74LS153（双4选1多路开关),试列出F₁,F₂的逻辑函数表达式

,并求其最简与或表达式.

图3.16所示逻辑电路所用器件为74LS153（双4选1多路开关),试列出F1,F2的逻辑函数表达式

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第5题

试分析图8．3．3给出的用PAL16R4构成的时序逻辑电路，写出电路的驱动方程、状态方程、输出方程，状态转

移表。

试分析图8．3．3给出的用PAL16R4构成的时序逻辑电路，写出电路的驱动方程、状态方程、输出方程，

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第6题

图题5.17是由计数器74LS161和8选1的数据选择器74LS151组成的时序逻辑电路。试分析电路的功能，电路在一系列CP

脉冲作用下序列信号输出的状态。

图题5.17是由计数器74LS161和8选1的数据选择器74LS151组成的时序逻辑电路。试分析电路

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第7题

试分析图P8.5给出的用PAL16R4构成的时序逻辑电路,写出电路的驱动方程、状态方程、输出方程,画出

电路的状态转换图.工作时,11脚接低电平.

试分析图P8.5给出的用PAL16R4构成的时序逻辑电路,写出电路的驱动方程、状态方程、输出方程,画

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第8题

图题5.2是一个自循环移位寄存器逻辑图，设各触发器的初态 Q2Q1Q0=001，试列出经过6个CP作用时Q2、Q1、Q0的波形。

图题5.2是一个自循环移位寄存器逻辑图，设各触发器的初态 Q₂Q₁Q₀=001，试列出经过6个CP作用时Q_2、Q₁、Q₀的波形。

图题5.2是一个自循环移位寄存器逻辑图，设各触发器的初态 Q2Q1Q0=001，试列出经过6个CP作

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第9题

用下降沿触发的边沿D触发器和与非门设计一同步逻辑电路，要求电路的时序图如图所示。

用下降沿触发的边沿D触发器和与非门设计一同步逻辑电路，要求电路的时序图如图所示。

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第10题

分析由JK触发器组成如图4.2.69所示的时序逻辑电路。分析电路的逻辑功能，画出Q1、Q2输出波形。设初始状态是11。

分析由JK触发器组成如图4.2.69所示的时序逻辑电路。分析电路的逻辑功能，画出Q₁、Q₂输出波形。设初始状态是11。

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