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[主观题]

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.（根据二-十进制数的加法运算规则,当两数之和小于、等于9（1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9（即等于1010~111)时,则应在按二进制数相加的结果上加6（0110),这样就以给出进位信号,同时得到一个小于9的和.)

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第1题
用4位二进制并行加法器设计一个实现8421码对9求补的逻辑电路。

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第2题
用两片1024×8位的EPROM接成一个数码转移器，将10位二进制数转移成等值的4位二-十进制数。 （1)

用两片1024×8位的EPROM接成一个数码转移器，将10位二进制数转移成等值的4位二-十进制数。 (1)试画出电路连接图，标明输入和输出； (2)当地址输入A9A8A7A6A5A4A3A2A1A0 分别为0000000000，1000000000，1111111111时，两片EPROM中对应地址中的数据各为何值？

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第3题
用4位数码比较器和4位加法器构成4位二进制数转换成8421BCD码的电路。
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第4题
有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.
有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6（0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.（1)请设计系统方框图;（2)请设计ASM流程图.

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第5题
试用4位加法器74HC283实现8位二进制运算。要求当K=0时，完成加法运算；K=1时，完成减法运算。

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第6题
试用4位二进制加法器74HC283设计一个码转换电路，将余3码转换为8421BCD码。

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第7题
用四位二进制并行加法器实现8421码转换成余3码的代码转换电路，是将输入8421码加上（）。

A.1100

B.0011

C.0001

D.0010

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第8题
集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。(1)分别说明图中两
集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。（1)分别说明图中两

集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。

(1)分别说明图中两部分电路的功能;

(2)画出图中74LVC161组成的电路的状态图;

(3)画出图中va、vb和v0的对应波形。

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第9题
用4位加法器构成的电路如图4．2．13所示，试列出电路的真值表，说明电路的逻辑功能。

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第10题
设有一个4位二进制数X，送到一个判别电路。要求：①当4≤X≤7时，输出YA=1②＞X≤3时，输出YB=1③当X≥8时，输出YC=1。

设有一个4位二进制数X，送到一个判别电路。要求：①当4≤X≤7时，输出YA=1②＞X≤3时，输出YB=1③当X≥8时，输出YC=1。试用两片4位数字比较器74LS85与若干个逻辑门实现此判别电路。

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第11题
中规模集成同步4位二进制加法计数器74LS161的功能表如附表所示，要求：将两片74LS161用预置数法构成从0开始的

81进制计数器，画出电路接线图。

CPbar{CR}bar{LD}CTPCTTD0D1D2D3Q0n+1Q1n+1Q2n+1Q3n+1
×0 ×× ×× × × ×0000
↑1 0× ×d0d1d2d3d0d1d2d3
×1 10 ×× × × ×保 持
×1 1× 0× × × ×保 持
↑1 11 1× × × ×4位二进制加法计数器

进位输出：CO=CTTQ3Q2Q1Q0

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