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第3题
在与非门基本RS触发器中，当输入信号R、S同时有效，即R=S=()时，触发器的2个输出端同时为逻辑()。
在与非门基本RS触发器中，当输入信号R、S同时有效，即R=S=（)时，触发器的2个输出端同时为逻辑（)。
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第4题
对于用两个或非门构成的基本SR锁存器，如果S=R=0，则触发器的状态应为（)。A．置0B．置1C．不变D．不
对于用两个或非门构成的基本SR锁存器，如果S=R=0，则触发器的状态应为()。
A．置0
B．置1
C．不变
D．不定
第5题
在时序逻辑电路中，R£S触发器是由()组成，Q是()输出端，Q是()输出端，R是()输入端，S是()输入端。
在时序逻辑电路中，R£S触发器是由（)组成，Q是（)输出端，Q是（)输出端，R是（)输入端，S是（)输入端。
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第7题
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如
画出图P5.6（a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如
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图P5.6(b)所示。设触发器的初始状态为Q=0。
第8题
在图所示的由与非门组成的基本RS触发器中，加入图示的S和R波形，画出触发器Q和输出端的波形。假设触发器的初始
在图所示的由与非门组成的基本RS触发器中，加入图示的S和R波形，画出触发器Q和
第9题
下列说法正确的为（)。
A.对于低电平有效的TTL型主从触发器，具有约束条件RS=1
B.RS触发器都可以用来组成移位寄存器
C.将D触发器的端与D端连接就可构成T'触发器
D.将主从RS触发器端与其中一个s端连接，Q端与其中一个R端连接，把其余的s端改为J，R端改为K就构成了主从JK触发器
E.RS触发器当R=1时就构成D锁存器
第10题
当可控RS触发器[教材图21.1.4（a)]的C，S和R端加上图21.22所示的波形时，试画出Q端的输出波形。设初始状态为0和
当可控RS触发器[教材图21.1.4(a)]的C，S和R端加上图21.22所示的波形时，试画出Q端的输出波形。设初始状态为0和1两种情况。
第11题
由单稳态触发器741 21构成的噪声消除电路及输入波形如图7．4．3所示。 （1)试说明消除噪声的
由单稳态触发器741 21构成的噪声消除电路及输入波形如图7．4．3所示。
(1)试说明消除噪声的原理，画出
及vO的波形； (2)若输入信号高电平持续时间为100μs，噪声宽度5μs，确定R的取值范围。
