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[主观题]

由4位比较器74LS85和4位二进制计数器74161构成的定时电路，如图7．2．1所示。Z为输出端，设比较器的输

入端A3A2A1A0接固定电平1001；计数器的数据输入端D3D2D1D0=0010。 (1)一个Z脉冲周期内包含多少个CP脉冲周期？ (2)若将

由4位比较器74LS85和4位二进制计数器74161构成的定时电路，如图7．2．1所示。Z为输出端，试求一个Z脉冲周期内应包含多少个CP脉冲周期。

由4位比较器74LS85和4位二进制计数器74161构成的定时电路，如图7．2．1所示。Z为输出端，

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更多“由4位比较器74LS85和4位二进制计数器74161构成的定…”相关的问题

第1题

图T8.3是一个用4位二进制加计数器74161和4位二进制数码比较器74LS85组成的逻辑电路，试判断电路的功能。

图T8.3是一个用4位二进制加计数器74161和4位二进制数码比较器74LS85组成的逻辑电路，试判

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第2题

设有一个4位二进制数X，送到一个判别电路。要求：①当4≤X≤7时，输出YA=1②＞X≤3时，输出YB=1③当X≥8时，输出YC=1。

设有一个4位二进制数X，送到一个判别电路。要求：①当4≤X≤7时，输出Y_A=1②＞X≤3时，输出Y_B=1③当X≥8时，输出Y_C=1。试用两片4位数字比较器74LS85与若干个逻辑门实现此判别电路。

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第3题

已知4位数值比较器74LS85的传输延迟时间（从加上两个输入比较数到产生输出比较结果所需时间)小于45ns。要求用

已知4位数值比较器74LS85的传输延迟时间(从加上两个输入比较数到产生输出比较结果所需时间)小于45ns。要求用6片74LS85接成一个24位数值比较电路，传输延迟时间不得大于90ns。

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第4题

用4位数码比较器和4位加法器构成4位二进制数转换成8421BCD码的电路。

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第5题

若4位二进制加法计数器正常工作时，由0000状态开始计数，则经过43个输入计数脉冲后，计数器的状态应该是（)。

A.0011

B.1011

C.1101

D.1110

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第6题

若4位二进制加法计数器正常工作时，由0000状态开始计数，则经过35个输入计数脉冲后，计数器的状态应该是（)。

A.1011

B.0011

C.1101

D.1110

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第7题

试用2个4位数值比较器组成三个数的判断电路。要求能够判断三个4位二进制数（A，B，C）是否相等，A是否最大，A是否最小，分别给出三个数相等、A最大、A最小的输出信号。其逻辑功能可以用图5 实现，其中F1表示A 最大 F2表示A=B=C， ..

试用2个4位数值比较器组成三个数的判断电路。要求能够判断三个4位二进制数（A，B，C）是否相等，A是否最大，A是否最小，分别给出三个数相等、A最大、A最小的输出信号。其逻辑功能可以用图5 实现，其中F1表示A 最大 F2表示A=B=C， F3表示A最小。 () 试用2个4位数值比较器组成三个数的判断电路。要求能够判断三个4位二进制数（A，B，C）是否相等，A是

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第8题

用4片四位数值比较器74LS85接成一个十六位二进制数的数值比较器。

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第9题

下列说法正确的是()。

A.半加器是全加器的基础

B.由四个1位全加器可以实现两个4位二进制数的加法运算

C.逻辑加法1+1=10

D.二进制数的加法1+1=10

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第10题

如图题6.27电路是由一个555定时器和一个4位二进制加法计数器组成的可调节计数式定时器原理图。试回答下列问

题：

(1) 电路中555定时器接成何种电路？

(2) 若计数器的初态Q₃Q₂Q₁Q₀=0000，当开关S接通后大约经过多少时间发光二极管D变亮(设电位器的阻值R₂全部接入电路)？

如图题6.27电路是由一个555定时器和一个4位二进制加法计数器组成的可调节计数式定时器原理图。试回

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