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[主观题]
用于片外数据存储器RAM的读/写控制信号是：（) （A) EA （B) RD （C) PSEN （D) WR
用于片外数据存储器RAM的读/写控制信号是：( )
(A) EA (B) RD (C) PSEN (D) WR
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用于片外数据存储器RAM的读/写控制信号是：( )
(A) EA (B) RD (C) PSEN (D) WR
高电平为读，低电平为写)。
已知该机存储器地址空间从0连续编址，其地址空间分配如下：最低8K为系统程序区，由ROM芯片组成;紧接着40K为备用区，暂不连接芯片;而后78K为用户程序和数据空间，用静态RAM芯片组成;最后2K用于I/O设备(与主存统一编址)。现有芯片如下：
SRAM：16K×8位，其中CS：为片选信号，低电平有效，WE：为写控制信号，低电平写，高电平读。
ROM：8K×8位，其中CS：为片选信号，低电平有效，OE：为读出控制，低电平读出有效。
译码器：3―8译码器，输出低电平有效;为使能信号，低电平时译码器功能有效。
其它“与、或”等逻辑门电路自选。
(1)请问该主存需多少SRAM芯片？
(2)试画出主存芯片与CPU的连接逻辑图。
(3)写出各芯片地址分配表。
电平为读，低电平为写)。现有下列存储芯片：1K×4位RAM，4K×8位RAM，2K×8位ROM，以及74138译码器和各种门电路，如图所示。画出CPU与存储器连接图，要求：1.主存地址空间分配：8000H～87FFH为系统程序区;8800H～8BFFH为用户程序区。
2.合理选用上述存储芯片，说明各选几片？
3.详细画出存储芯片的片选逻辑。
,读/写信号线R/W。请回答：
1、画出该存储芯片级逻辑图，包括地址总线、数据线、片选信号线(低电平有效)及读/写信号线的连接。
2、将地址总线A15～A0中的哪几位分配给存储芯片,并写出各片选信号的逻辑式，即
CS0=？CS1=？CS2=？CS3=
A．片选信号 B．读外RAM相应存储单元的地址信号
C．读外RAM操作信号 D．
