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[主观题]
图4-28(a)、(b)为两种锁存器的原理图,设输入信号如图4-28(c)所示,且各门电路均有延迟tpd,试画出这
图4-28(a)、(b)为两种锁存器的原理图,设输入信号如图4-28(c)所示,且各门电路均有延迟tpd,试画出这两种电路的有关各点a、b、c以及输出端M的波形,说明图4-28(b)所示电路的缺点。设M的初态为0。
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图4-28(a)、(b)为两种锁存器的原理图,设输入信号如图4-28(c)所示,且各门电路均有延迟tpd,试画出这两种电路的有关各点a、b、c以及输出端M的波形,说明图4-28(b)所示电路的缺点。设M的初态为0。
试用1片八D锁存器74HC373设计一个能锁存两组BCD码信号的锁存电路。假定三态输出使能端,锁存器原输出为,输入为,画出锁存器锁存新数据前、后使能端LE应输入的波形和相应Q0的波形。
欲使与非门构成的基本SR锁存器保持原态不变,则输入信号应为()。
A.S=R=0
B.S=R=1
C.S=1,R=0
D.S=0,R=I
A.电平敏感的存储器件称为锁存器
B.锁存器可分为高电平锁存器和低电平锁存器
C.触发器是有交叉耦合的门构成的双稳态的存储原件
D.锁存器为边缘敏感
逻辑门控D锁存器及其输入端D、E的电压波形分别如图4.3.1(a)、(b)所示,分析该电路的逻辑功能,并对应输入电压波形画出输出端Q和
的电压波形,设电路的初始状态为0。