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[主观题]
由一位全加器FA、2-4线译码器及与非门组成的逻辑电路如图4.2.2所示,试写出逻辑函数f(a,b,c,d)的最
由一位全加器FA、2-4线译码器及与非门组成的逻辑电路如图4.2.2所示,试写出逻辑函数f(a,b,c,d)的最小项表达式。
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由一位全加器FA、2-4线译码器及与非门组成的逻辑电路如图4.2.2所示,试写出逻辑函数f(a,b,c,d)的最小项表达式。
A、真值表:
B、真值表:
C、逻辑函数表达式:
D、利用与非门设计实现:
E、利用3线-8线译码器芯片74138及基本逻辑门设计实现:
要求写出设计过程,并画出连接图.
用3线—8线译码器设计一个既能做一位二进制数的令加运算,又能做一位二进制数的伞减运算的电路。
要求:(1)根据题意要求,写真值表。
(2)写出电路输出函数的最简与或表达式。
(3)画出用3线—8线译码器74LS138芯片实现的电路。