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[主观题]

图题5.17是由计数器74LS161和8选1的数据选择器74LS151组成的时序逻辑电路。试分析电路的功能,电路在一系列CP

脉冲作用下序列信号输出的状态。

图题5.17是由计数器74LS161和8选1的数据选择器74LS151组成的时序逻辑电路。试分析电路

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第1题
试分析图11.20(a)电路的工作原理,画出输出电压vO的波形图。其中,74HC151是8选1数据选择器。74LS161为同步十六

试分析图11.20(a)电路的工作原理,画出输出电压vO的波形图。其中,74HC151是8选1数据选择器。74LS161为同步十六进制加法计数器。假定74LS161和反相器G1的输出电阻远远小于R的阻值。74HC151各输入端的电压波形如图11.20(b)所示。

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第2题
74LS161为十六进制计数器,图是74LS161组成的一可变进制计数器,试分析:当A=1时是几进制计数器( ) 当A=0时是几进制计数器( )

A.12进制

B.11进制

C.10进制

D.9进制

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第3题
中规模集成计数器74LS161的GND是第几引脚()。

A.1

B.8

C.14

D.16

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第4题
如图所示的电路是由10位D/A转换器AD7520和同步十六进制计数器74LS161组成的波形发生器电路。已知AD7520的VRE

如图所示的电路是由10位D/A转换器AD7520和同步十六进制计数器74LS161组成的波形发生器电路。已知AD7520的VREF=-10V,试画出输出电压vo的波形,并标出波形图上各点电压的幅值。

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第5题
对于HARTModem所需要的输入时钟,采用73728MHz的晶振通过两个计数器74LS161进行两次4分频,得到()分频的时钟。

A.8

B.16

C.64

D.256

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第6题
集成计数器74LS161是()计数器。A.四位二进制加法B.四位二进制减法C.五位二进制加法D.三位二进制

集成计数器74LS161是()计数器。

A.四位二进制加法

B.四位二进制减法

C.五位二进制加法

D.三位二进制加法

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第7题
555定时器,同步十六进制计数器74LS161和运算放大器组成如图所示电路。

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第8题
两片集成计数器74LS161,最多可构成()进制计数器。A.256B.16C.200D.100

两片集成计数器74LS161,最多可构成()进制计数器。

A.256

B.16

C.200

D.100

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第9题
一片中规模集成计数器74LS161有()个引脚
一片中规模集成计数器74LS161有()个引脚

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第10题
用计数器74LS161和ROM设计产生序列信号为10110的序列信号发生器。

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第11题
驱动中规模集成计数器74LS161的时钟动作沿是()。

A.时钟上升沿

B.时钟下降沿

C.上升和下降沿都有效

D.上升沿和下降沿随机

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