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第6题
某机器的寻址空间为64K，数据总线为8位。现有8K×8位SRAM芯片，SRAM有CS和WE控制信号；4K×8位DRAM芯片
，DRAM有CS、wE等控制信号，数据总线是双向。CPU有MERQ、R／W等控制信号(表示低电平有效)。 (1)写出DRAM控制器内部的逻辑部件名称； (2)从0000H开始安排32K×8位SRAM，从A000H安排8K×8位DRAM，画出CPU的DRAM存储器连接电路图(包括74LS138等组成的片选电路、DRAM控制器，DRAM控制器仅要求画出输入、输出信号)； (3)设DRAM读／写周期为0．5μs，CPU在1μs内要访问内存1次或2次，平均1μs访存约1．2次，刷新周期为2ms。有哪几种刷新方式，采用哪种刷新方式比较合理，并说明采用的刷新方式的时间参数和理由。
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第7题
在现行PC中，常用存储器地址线中的低10位作为输入/输出接口地址线。设某接口芯片内部有16个端口，该接口芯片的片选信号由地址译码器产生。则地址译码器的输入地址线一般应为______。
A.全部10位地址线
B.其中的高8位地址线
C.其中的高6位地址线
D.其中的高4位地址线
第8题
在现行PC机中。常用存储器地址线中的低10位作为输入/输出接口地址线。设某接口芯片内部有16个端口，该接口芯片的片选信号由地址译码器产生。则地址译码器的输入地址线一般应为：______。
A.全部10位地址线
B.其中的高8位地址线
C.其中的高6位地址线
D.其中的高4位地址线
第9题
在现行PC机中。常用存储器地址线中的低10位作为输入/输出接口地址线。设某接口芯片内部有16个端口，该接口芯片的片选信号由地址译码器产生。则地址译码器的输入地址线一般应为：______。
A.全部10位地址线
B.其中的高8位地址线
C.其中的高6位地址线
D.其中的高4位地址线
第10题
设CPU共有16根地址线，8根数据线，并用MREQ作访存控制信号(低电平有效)，用WR作读写控制信号(高
设CPU共有16根地址线，8根数据线，并用MREQ作访存控制信号（低电平有效)，用WR作读写控制信号（高
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电平为读，低电平为写)。现有下列存储芯片：1K×4位RAM，4K×8位RAM，2K×8位ROM，以及74138译码器和各种门电路，如图所示。画出CPU与存储器连接图，要求：1.主存地址空间分配：8000H～87FFH为系统程序区;8800H～8BFFH为用户程序区。
2.合理选用上述存储芯片，说明各选几片？
3.详细画出存储芯片的片选逻辑。
