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[主观题]
逻辑无环流可逆系统中,需设置封锁延时时间tdb1和开放延时时间tdt,有人从简化电路出发,想取消tdb1,把开放延
逻辑无环流可逆系统中,需设置封锁延时时间tdb1和开放延时时间tdt,有人从简化电路出发,想取消tdb1,把开放延时时间延长到tdb1+tdt;或者取消tdt,把封锁延时时间延长到tdb1+tdt,试问这两种设想可行否,为什么?
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逻辑无环流可逆系统中,需设置封锁延时时间tdb1和开放延时时间tdt,有人从简化电路出发,想取消tdb1,把开放延时时间延长到tdb1+tdt;或者取消tdt,把封锁延时时间延长到tdb1+tdt,试问这两种设想可行否,为什么?