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8086正常的存储器读/写总线周期由4个T状态组成，ALE信号在T1状态内有效，其作用是给外部的地址锁存器提供一个地址锁存信号。（)
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一个Cache—主存系统，采用50 MHz的时钟，存储器以每一个时钟周期(简称周期)传输一个字的速率，连续传输8个字，以支持块长为8个字的Cache，每字4个字节。假设读操作所花的时间是：1个周期接收地址，3个周期延迟，8个周期传输8个字；写操作所花的时间是：1个周期接受地址，2个周期延迟，8个周期传输8个字，3个周期恢复和写入纠错码。求出对应下述几种情况的存储器最大带宽。 (1)全部访问为读操作。 (2)全部访问为写操作。 (3)65％的访问为读操作，35％的访问为写操作。
A.用来传送CPU发向存储器的读/写控制信号
B.用来传送CPU发向I/O接口的读/写控制信号
C.CPU的控制信号越多，它对外电路的控制能力就越强
D.复位和时钟信号是由模型计算机CPU发出的
