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[单选题]

在下列Verilog HDL的操作符中,优先级最低的是( )操作符。

A.&&

B.?

C.*

D.!

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第1题
在Verilog HDL设计文件中,用______来表示高阻输出状态。
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第2题
在Verilog HDL中,高阻态是用( )表示。

A.a或A

B.x或X

C.b或B

D.z或Z

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第3题
在Verilog HDL的并接操作运算中,已知A=8'b11010001,B=8'b10100010,则{A[3:0],B[5:2]}的结果是()。

A.8'b11010001

B.8'b10100010

C.8'b00011000

D.8'b11110000

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第4题
Verilog HDL于______推出,是在______的基础上演化而来的。
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第5题
Verilog HDL的信号类型声明用来声明设计电路的功能描述中所用的信号的______和______。
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第6题
在Verilog HDL的端口声明语句中,用( )关键字声明端口为输出方向。

A.input

B.INPUT

C.OUT

D.output

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第7题
一个完整的Verilog HDL设计模块包括______、______、______和______4个部分。
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第8题
Verilog HDL的异或门和同或门的关键字是______和______。
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第9题
用Verilog HDL设计具有异步清除功能的十二进制加减法可控计数器。

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第10题
用Verilog HDL设计门电路时,可以采用______建模和______建模的方法来描述。
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