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第3题
主从JK触发器的初始状态为0，在时钟脉冲CP的下降沿触发器的状态变为1，能够实现这种转换的JK取值可能为（)。
A.CP=1期间，JK=10
B.CP=1期间，JK=01
C.CP=1期间，JK=11
D.CP=1期间，JK从01变为11
第4题
74LS175型四上升沿D触发器和74LS112型双下降沿JK触发器的接线图如图 21.40（a)所示，它们的外引线排列分别见
74LS175型四上升沿D触发器和74LS112型双下降沿JK触发器的接线图如图 21.40(a)所示，它们的外引线排列分别见教材图21.6.4(b)和教材图21.11(b)。(1)试按图画出逻辑电路；(2)设CP，
，D1的波形如图21.40(b)所示，试画出两触发器输出端Q的波形。两触发器的初始状态均为0。
第7题
如图中上升沿触发的D触发器和下降沿触发的JK触发器的CP、D、波形如图所示，试画出Q的波形。
如图中上升沿触发的D触发器和下降沿触发的JK触发器的CP、D波形如图所示，试画出Q的波形。
第9题
图题4.10是利用上升沿JK触发器CD4027构成，已知CP、R、J、K的电压波形如图所示，试画出输出端Q和端的电压波形。
图题4.10是利用上升沿JK触发器CD4027构成，已知CP、R、J、K的电压波形如图所示，试画出输出端Q和
