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[主观题]

试设计一个实现下述要求的Locate运算的函数。设有一个带附加头结点的双向链表L, 每个结点有4

个数据成员:指向前驱结点的指针prior、指向后继结点的指针next、存放数据的成员data和访问频度freq。所有结点的freq初始时都为0。每当在链表上进行一次Locate(x) 操作时, 令元素值为x的结点的访问频度freq加1, 并将该结点前移,链接到与它的访问频度和等的结点后面,使得链表中所有结点保持按访问频度递减的顺序排列,以使频繁访问的结点总是靠近表头。

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第1题
设有一头指针为L的带有表头结点的非循环双向链表,其每个结点中除有pred(前驱指针)、data(数据)和n

设有一头指针为L的带有表头结点的非循环双向链表,其每个结点中除有pred(前驱指针)、data(数据)和next(后继指针)域外,还有一个访问频度域freq。在链表被起用前,其值均初始化为零。每当在链表中进行一次Locate(L,x)运算时,令元素值为x的结点中freq域的值增1,并使此链表中结点保持按访问频度非增(递减)的顺序排列,同时最近访问的结点排在频度相同的结点的最后,以便使频繁访问的结点总是靠近表头。试编写符合上述要求的Locate(L,x)运算的算法,该运算为函数过程,返回找到结点的地址,类型

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第2题
顺序存储的线性表 实验目的: (1)了解线性表的逻辑结构特征。 (2)熟练掌握线性表的顺序存储结构的描述方法

顺序存储的线性表

实验目的:

(1)了解线性表的逻辑结构特征。

(2)熟练掌握线性表的顺序存储结构的描述方法,及在其上实现各种基本运算的方法。

(3)掌握和理解本实验中出现的一些基本的c语言语句。

(4)体会算法在程序设计中的重要性。

实验内容:

(1)将一顺序表a中的元素逆置。要求算法仅用一个辅助结点。

(2)求顺序表中的元素的最大值和次最大值。

(3)试设计一个算法,仅用一个辅助结点,实现将顺序表a中的结点循环右移k位的运算。

(4)设一顺序表中元素值递增有序。试设计一算法,将元素x插入到表中适当的位置上,并保持顺序表的有序性。

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第3题
若给定反馈电阻Rf=10kΩ,试设计实现uo=ui1-ui2的运算电路。

若给定反馈电阻Rf=10kΩ,试设计实现uo=ui1-ui2的运算电路。

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第4题
试用JK触发器设计一个2位同步二进制多功能计数器。当控制端XY=00时,计数器状态不变;XY=01时,为加
法计数;XY=10时,为减法计数;XY=11时,则次态为现态求反运算。试写出该计数电路的控制输入真值表(包括状态转换激励表),并画出用与非门和JK触发器实现这一控制的逻辑电路图。

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第5题
用3线—8线译码器设计一个既能做一位二进制数的令加运算,又能做一位二进制数的伞减运算的电路。 要求:(1)根

用3线—8线译码器设计一个既能做一位二进制数的令加运算,又能做一位二进制数的伞减运算的电路。

要求:(1)根据题意要求,写真值表。

(2)写出电路输出函数的最简与或表达式。

(3)画出用3线—8线译码器74LS138芯片实现的电路。

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第6题
组合电路设计:用最少的门电路设计一个4位8421BCD码运算电路,该电路有4个输入端,4个输出端:将输入和输出都作

为4位8421BCD码表达的数量:要求该电路实现下列功能:当输入小于5时,输出等于输入加2:当输入大于等于5时,输出等于输入减3。要求写出各输出逻辑函数的最小项和表达式。

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第7题
主程序定义X、Y、Z字变量。要求完成X=Y+Z运算。运算由外部模块实现。试按模块化程序设计编写主模块及运算子模块。
并实现两者的连接关系。
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第8题
设受控对象的开环模型为试采用四阶参考模型法设计校正装置Ge(s),使得校正后实现下述性能指标
设受控对象的开环模型为试采用四阶参考模型法设计校正装置Ge(s),使得校正后实现下述性能指标

设受控对象的开环模型为

试采用四阶参考模型法设计校正装置Ge(s),使得校正后实现下述性能指标

(a)静志速度误差系数Ky≥80:

(b)开环截止频率we>2:

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第9题
试设计一个三人抢答逻辑电路,要求: (1)每位参赛者有一个按钮,按下就发出抢答信号。 (2)主持人另有一个按钮

试设计一个三人抢答逻辑电路,要求:

(1)每位参赛者有一个按钮,按下就发出抢答信号。

(2)主持人另有一个按钮,按下电路复位。

(3)先按下按钮者将相应的一个发光二极管点亮,此后他人再按下各自的按钮,电路不起作用。

(建议:可用由两片74LS00组成的三个基本RS触发器和由两片74LS20组成的三个与非门来实现)

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第10题
设计一个二端口电路实现下述参数

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第11题
试用4位全加器74HC283设计一个实现6位二进制数的5倍运算电路。

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