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[主观题]
图题4.10是利用上升沿JK触发器CD4027构成,已知CP、R、J、K的电压波形如图所示,试画出输出端Q和端的电压波形。
图题4.10是利用上升沿JK触发器CD4027构成,已知CP、R、J、K的电压波形如图所示,试画出输出端Q和端的电压波形。
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图题4.10是利用上升沿JK触发器CD4027构成,已知CP、R、J、K的电压波形如图所示,试画出输出端Q和端的电压波形。
74LS175型四上升沿D触发器和74LS112型双下降沿JK触发器的接线图如图 21.40(a)所示,它们的外引线排列分别见教材图21.6.4(b)和教材图21.11(b)。(1)试按图画出逻辑电路;(2)设CP,,D1的波形如图21.40(b)所示,试画出两触发器输出端Q的波形。两触发器的初始状态均为0。
如图中上升沿触发的D触发器和下降沿触发的JK触发器的CP、D波形如图所示,试画出Q的波形。
同步计数器设计
用JK下降沿触发器构成能够自启动的五进制同步计数器,已知状态转移过程的编码为:110→011→100→001→101→110,写出该触发器的状态方程、激励方程,画出该计数器的状态转移图和逻辑图(触发器输入可提供多输入相与功能,若需要外接逻辑门,使用与非门)。
画出触发器输出端Q对应的电压波形。
译码器组成一个周期序列信号发生器,每个周期的序列信号为01101,画出电路图,写出必要的过程。
Q2 | Q1 | Q0 |
0 | 0 | 0 |
0 | 0 | 1 |
1 | 0 | 0 |
1 | 0 | 1 |
1 | 1 | 1 |