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[主观题]

同步计数器设计 用JK下降沿触发器构成能够自启动的五进制同步计数器,已知状态转移过程的编码为:110→011→10

同步计数器设计

用JK下降沿触发器构成能够自启动的五进制同步计数器,已知状态转移过程的编码为:110→011→100→001→101→110,写出该触发器的状态方程、激励方程,画出该计数器的状态转移图和逻辑图(触发器输入可提供多输入相与功能,若需要外接逻辑门,使用与非门)。

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第1题
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第3题
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Q2Q1Q0
000
001
100
101
111
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第6题
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法计数;XY=10时,为减法计数;XY=11时,则次态为现态求反运算。试写出该计数电路的控制输入真值表(包括状态转换激励表),并画出用与非门和JK触发器实现这一控制的逻辑电路图。

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第7题
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第8题
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第9题
试用上升沿触发的JK触发器设计一同步时序电路,其状态图如下图所示,要求电路使用的门电路最少。

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第10题
用下降沿触发的边沿D触发器和与非门设计一同步逻辑电路,要求电路的时序图如图所示。

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